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201398c3
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201398c3
authored
11 years ago
by
Johann
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11 years ago
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Merge "Replace vqshrun by vqmovun if shift #0 bit"
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671514eb
e486488c
v1.14.0-linphone
1.4.X
feature/update_to_v1.9.0-linphone
feature/uwp_nuget
frame_parallel
highbitdepth
indianrunnerduck
javanwhistlingduck
khakicampbell
linphone
linphone-android
linphone-old
longtailedduck
m49-2623
m52-2743
m54-2840
m56-2924
m66-3359
m68-3440
mandarinduck
nextgen
nextgenv2
playground
sandbox/Jingning/experimental
sandbox/Jingning/transcode
sandbox/Jingning/vpx
sandbox/aconverse@google.com/ansbench
sandbox/hkuang/frame_parallel
sandbox/hkuang@google.com/decode
sandbox/jimbankoski@google.com/proposed-aom
sandbox/jingning@google.com/decoder_test_suite
sandbox/jingning@google.com/experimental
sandbox/jzern@google.com/test
sandbox/wangch@google.com/vp9
sandbox/yaowu@google.com/mergeaom
v1.12.0-linphone
v1.6.1_linphone
v1.7.0-linphone
v1.9.0-linphone
v1.9.0
v1.9.0-rc1
v1.8.2
v1.8.1
v1.8.0
v1.7.0
v1.6.1
v1.6.0
v1.5.0
v1.4.0
No related merge requests found
Changes
1
Hide whitespace changes
Inline
Side-by-side
Showing
1 changed file
vp9/common/arm/neon/vp9_reconintra_neon.asm
+60
-60
vp9/common/arm/neon/vp9_reconintra_neon.asm
with
60 additions
and
60 deletions
vp9/common/arm/neon/vp9_reconintra_neon.asm
+
60
−
60
View file @
201398c3
...
@@ -315,8 +315,8 @@ loop_h
...
@@ -315,8 +315,8 @@ loop_h
vdup.u16
q2
,
r2
vdup.u16
q2
,
r2
vadd.s16
q1
,
q1
,
q3
vadd.s16
q1
,
q1
,
q3
vadd.s16
q2
,
q2
,
q3
vadd.s16
q2
,
q2
,
q3
vq
shr
un.s16
d0
,
q1
,
#
0
vq
mov
un.s16
d0
,
q1
vq
shr
un.s16
d1
,
q2
,
#
0
vq
mov
un.s16
d1
,
q2
vst1.32
{
d0
[
0
]
}
,
[
r0
],
r1
vst1.32
{
d0
[
0
]
}
,
[
r0
],
r1
vst1.32
{
d1
[
0
]
}
,
[
r0
],
r1
vst1.32
{
d1
[
0
]
}
,
[
r0
],
r1
...
@@ -327,8 +327,8 @@ loop_h
...
@@ -327,8 +327,8 @@ loop_h
vdup.u16
q2
,
r2
vdup.u16
q2
,
r2
vadd.s16
q1
,
q1
,
q3
vadd.s16
q1
,
q1
,
q3
vadd.s16
q2
,
q2
,
q3
vadd.s16
q2
,
q2
,
q3
vq
shr
un.s16
d0
,
q1
,
#
0
vq
mov
un.s16
d0
,
q1
vq
shr
un.s16
d1
,
q2
,
#
0
vq
mov
un.s16
d1
,
q2
vst1.32
{
d0
[
0
]
}
,
[
r0
],
r1
vst1.32
{
d0
[
0
]
}
,
[
r0
],
r1
vst1.32
{
d1
[
0
]
}
,
[
r0
],
r1
vst1.32
{
d1
[
0
]
}
,
[
r0
],
r1
bx
lr
bx
lr
...
@@ -372,10 +372,10 @@ loop_h
...
@@ -372,10 +372,10 @@ loop_h
vadd.s16
q8
,
q3
,
q8
vadd.s16
q8
,
q3
,
q8
vadd.s16
q9
,
q3
,
q9
vadd.s16
q9
,
q3
,
q9
vq
shr
un.s16
d0
,
q0
,
#
0
vq
mov
un.s16
d0
,
q0
vq
shr
un.s16
d1
,
q1
,
#
0
vq
mov
un.s16
d1
,
q1
vq
shr
un.s16
d2
,
q8
,
#
0
vq
mov
un.s16
d2
,
q8
vq
shr
un.s16
d3
,
q9
,
#
0
vq
mov
un.s16
d3
,
q9
vst1.64
{
d0
}
,
[
r0
],
r1
vst1.64
{
d0
}
,
[
r0
],
r1
vst1.64
{
d1
}
,
[
r0
],
r1
vst1.64
{
d1
}
,
[
r0
],
r1
...
@@ -394,10 +394,10 @@ loop_h
...
@@ -394,10 +394,10 @@ loop_h
vadd.s16
q8
,
q3
,
q8
vadd.s16
q8
,
q3
,
q8
vadd.s16
q9
,
q3
,
q9
vadd.s16
q9
,
q3
,
q9
vq
shr
un.s16
d0
,
q0
,
#
0
vq
mov
un.s16
d0
,
q0
vq
shr
un.s16
d1
,
q1
,
#
0
vq
mov
un.s16
d1
,
q1
vq
shr
un.s16
d2
,
q8
,
#
0
vq
mov
un.s16
d2
,
q8
vq
shr
un.s16
d3
,
q9
,
#
0
vq
mov
un.s16
d3
,
q9
vst1.64
{
d0
}
,
[
r0
],
r1
vst1.64
{
d0
}
,
[
r0
],
r1
vst1.64
{
d1
}
,
[
r0
],
r1
vst1.64
{
d1
}
,
[
r0
],
r1
...
@@ -445,10 +445,10 @@ loop_16x16_neon
...
@@ -445,10 +445,10 @@ loop_16x16_neon
vadd.s16
q0
,
q0
,
q3
vadd.s16
q0
,
q0
,
q3
vadd.s16
q11
,
q8
,
q2
vadd.s16
q11
,
q8
,
q2
vadd.s16
q8
,
q8
,
q3
vadd.s16
q8
,
q8
,
q3
vq
shr
un.s16
d2
,
q1
,
#
0
vq
mov
un.s16
d2
,
q1
vq
shr
un.s16
d3
,
q0
,
#
0
vq
mov
un.s16
d3
,
q0
vq
shr
un.s16
d22
,
q11
,
#
0
vq
mov
un.s16
d22
,
q11
vq
shr
un.s16
d23
,
q8
,
#
0
vq
mov
un.s16
d23
,
q8
vdup.16
q0
,
d20
[
2
]
; proload next 2 rows data
vdup.16
q0
,
d20
[
2
]
; proload next 2 rows data
vdup.16
q8
,
d20
[
3
]
vdup.16
q8
,
d20
[
3
]
vst1.64
{
d2
,
d3
}
,
[
r0
],
r1
vst1.64
{
d2
,
d3
}
,
[
r0
],
r1
...
@@ -459,10 +459,10 @@ loop_16x16_neon
...
@@ -459,10 +459,10 @@ loop_16x16_neon
vadd.s16
q0
,
q0
,
q3
vadd.s16
q0
,
q0
,
q3
vadd.s16
q11
,
q8
,
q2
vadd.s16
q11
,
q8
,
q2
vadd.s16
q8
,
q8
,
q3
vadd.s16
q8
,
q8
,
q3
vq
shr
un.s16
d2
,
q1
,
#
0
vq
mov
un.s16
d2
,
q1
vq
shr
un.s16
d3
,
q0
,
#
0
vq
mov
un.s16
d3
,
q0
vq
shr
un.s16
d22
,
q11
,
#
0
vq
mov
un.s16
d22
,
q11
vq
shr
un.s16
d23
,
q8
,
#
0
vq
mov
un.s16
d23
,
q8
vdup.16
q0
,
d21
[
0
]
; proload next 2 rows data
vdup.16
q0
,
d21
[
0
]
; proload next 2 rows data
vdup.16
q8
,
d21
[
1
]
vdup.16
q8
,
d21
[
1
]
vst1.64
{
d2
,
d3
}
,
[
r0
],
r1
vst1.64
{
d2
,
d3
}
,
[
r0
],
r1
...
@@ -472,10 +472,10 @@ loop_16x16_neon
...
@@ -472,10 +472,10 @@ loop_16x16_neon
vadd.s16
q0
,
q0
,
q3
vadd.s16
q0
,
q0
,
q3
vadd.s16
q11
,
q8
,
q2
vadd.s16
q11
,
q8
,
q2
vadd.s16
q8
,
q8
,
q3
vadd.s16
q8
,
q8
,
q3
vq
shr
un.s16
d2
,
q1
,
#
0
vq
mov
un.s16
d2
,
q1
vq
shr
un.s16
d3
,
q0
,
#
0
vq
mov
un.s16
d3
,
q0
vq
shr
un.s16
d22
,
q11
,
#
0
vq
mov
un.s16
d22
,
q11
vq
shr
un.s16
d23
,
q8
,
#
0
vq
mov
un.s16
d23
,
q8
vdup.16
q0
,
d21
[
2
]
; proload next 2 rows data
vdup.16
q0
,
d21
[
2
]
; proload next 2 rows data
vdup.16
q8
,
d21
[
3
]
vdup.16
q8
,
d21
[
3
]
vst1.64
{
d2
,
d3
}
,
[
r0
],
r1
vst1.64
{
d2
,
d3
}
,
[
r0
],
r1
...
@@ -486,10 +486,10 @@ loop_16x16_neon
...
@@ -486,10 +486,10 @@ loop_16x16_neon
vadd.s16
q0
,
q0
,
q3
vadd.s16
q0
,
q0
,
q3
vadd.s16
q11
,
q8
,
q2
vadd.s16
q11
,
q8
,
q2
vadd.s16
q8
,
q8
,
q3
vadd.s16
q8
,
q8
,
q3
vq
shr
un.s16
d2
,
q1
,
#
0
vq
mov
un.s16
d2
,
q1
vq
shr
un.s16
d3
,
q0
,
#
0
vq
mov
un.s16
d3
,
q0
vq
shr
un.s16
d22
,
q11
,
#
0
vq
mov
un.s16
d22
,
q11
vq
shr
un.s16
d23
,
q8
,
#
0
vq
mov
un.s16
d23
,
q8
vld1.8
{
d18
}
,
[
r3
]
!
; preload 8 left into r12
vld1.8
{
d18
}
,
[
r3
]
!
; preload 8 left into r12
vmovl.u8
q10
,
d18
vmovl.u8
q10
,
d18
vst1.64
{
d2
,
d3
}
,
[
r0
],
r1
vst1.64
{
d2
,
d3
}
,
[
r0
],
r1
...
@@ -542,19 +542,19 @@ loop_32x32_neon
...
@@ -542,19 +542,19 @@ loop_32x32_neon
vadd.s16
q13
,
q0
,
q9
vadd.s16
q13
,
q0
,
q9
vadd.s16
q14
,
q0
,
q10
vadd.s16
q14
,
q0
,
q10
vadd.s16
q15
,
q0
,
q11
vadd.s16
q15
,
q0
,
q11
vq
shr
un.s16
d0
,
q12
,
#
0
vq
mov
un.s16
d0
,
q12
vq
shr
un.s16
d1
,
q13
,
#
0
vq
mov
un.s16
d1
,
q13
vadd.s16
q12
,
q2
,
q8
vadd.s16
q12
,
q2
,
q8
vadd.s16
q13
,
q2
,
q9
vadd.s16
q13
,
q2
,
q9
vq
shr
un.s16
d2
,
q14
,
#
0
vq
mov
un.s16
d2
,
q14
vq
shr
un.s16
d3
,
q15
,
#
0
vq
mov
un.s16
d3
,
q15
vadd.s16
q14
,
q2
,
q10
vadd.s16
q14
,
q2
,
q10
vadd.s16
q15
,
q2
,
q11
vadd.s16
q15
,
q2
,
q11
vst1.64
{
d0
-
d3
}
,
[
r0
],
r1
vst1.64
{
d0
-
d3
}
,
[
r0
],
r1
vq
shr
un.s16
d24
,
q12
,
#
0
vq
mov
un.s16
d24
,
q12
vq
shr
un.s16
d25
,
q13
,
#
0
vq
mov
un.s16
d25
,
q13
vq
shr
un.s16
d26
,
q14
,
#
0
vq
mov
un.s16
d26
,
q14
vq
shr
un.s16
d27
,
q15
,
#
0
vq
mov
un.s16
d27
,
q15
vdup.16
q1
,
d6
[
2
]
vdup.16
q1
,
d6
[
2
]
vdup.16
q2
,
d6
[
3
]
vdup.16
q2
,
d6
[
3
]
vst1.64
{
d24
-
d27
}
,
[
r0
],
r1
vst1.64
{
d24
-
d27
}
,
[
r0
],
r1
...
@@ -564,19 +564,19 @@ loop_32x32_neon
...
@@ -564,19 +564,19 @@ loop_32x32_neon
vadd.s16
q13
,
q1
,
q9
vadd.s16
q13
,
q1
,
q9
vadd.s16
q14
,
q1
,
q10
vadd.s16
q14
,
q1
,
q10
vadd.s16
q15
,
q1
,
q11
vadd.s16
q15
,
q1
,
q11
vq
shr
un.s16
d0
,
q12
,
#
0
vq
mov
un.s16
d0
,
q12
vq
shr
un.s16
d1
,
q13
,
#
0
vq
mov
un.s16
d1
,
q13
vadd.s16
q12
,
q2
,
q8
vadd.s16
q12
,
q2
,
q8
vadd.s16
q13
,
q2
,
q9
vadd.s16
q13
,
q2
,
q9
vq
shr
un.s16
d2
,
q14
,
#
0
vq
mov
un.s16
d2
,
q14
vq
shr
un.s16
d3
,
q15
,
#
0
vq
mov
un.s16
d3
,
q15
vadd.s16
q14
,
q2
,
q10
vadd.s16
q14
,
q2
,
q10
vadd.s16
q15
,
q2
,
q11
vadd.s16
q15
,
q2
,
q11
vst1.64
{
d0
-
d3
}
,
[
r0
],
r1
vst1.64
{
d0
-
d3
}
,
[
r0
],
r1
vq
shr
un.s16
d24
,
q12
,
#
0
vq
mov
un.s16
d24
,
q12
vq
shr
un.s16
d25
,
q13
,
#
0
vq
mov
un.s16
d25
,
q13
vq
shr
un.s16
d26
,
q14
,
#
0
vq
mov
un.s16
d26
,
q14
vq
shr
un.s16
d27
,
q15
,
#
0
vq
mov
un.s16
d27
,
q15
vdup.16
q0
,
d7
[
0
]
vdup.16
q0
,
d7
[
0
]
vdup.16
q2
,
d7
[
1
]
vdup.16
q2
,
d7
[
1
]
vst1.64
{
d24
-
d27
}
,
[
r0
],
r1
vst1.64
{
d24
-
d27
}
,
[
r0
],
r1
...
@@ -586,19 +586,19 @@ loop_32x32_neon
...
@@ -586,19 +586,19 @@ loop_32x32_neon
vadd.s16
q13
,
q0
,
q9
vadd.s16
q13
,
q0
,
q9
vadd.s16
q14
,
q0
,
q10
vadd.s16
q14
,
q0
,
q10
vadd.s16
q15
,
q0
,
q11
vadd.s16
q15
,
q0
,
q11
vq
shr
un.s16
d0
,
q12
,
#
0
vq
mov
un.s16
d0
,
q12
vq
shr
un.s16
d1
,
q13
,
#
0
vq
mov
un.s16
d1
,
q13
vadd.s16
q12
,
q2
,
q8
vadd.s16
q12
,
q2
,
q8
vadd.s16
q13
,
q2
,
q9
vadd.s16
q13
,
q2
,
q9
vq
shr
un.s16
d2
,
q14
,
#
0
vq
mov
un.s16
d2
,
q14
vq
shr
un.s16
d3
,
q15
,
#
0
vq
mov
un.s16
d3
,
q15
vadd.s16
q14
,
q2
,
q10
vadd.s16
q14
,
q2
,
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vadd.s16
q15
,
q2
,
q11
vadd.s16
q15
,
q2
,
q11
vst1.64
{
d0
-
d3
}
,
[
r0
],
r1
vst1.64
{
d0
-
d3
}
,
[
r0
],
r1
vq
shr
un.s16
d24
,
q12
,
#
0
vq
mov
un.s16
d24
,
q12
vq
shr
un.s16
d25
,
q13
,
#
0
vq
mov
un.s16
d25
,
q13
vq
shr
un.s16
d26
,
q14
,
#
0
vq
mov
un.s16
d26
,
q14
vq
shr
un.s16
d27
,
q15
,
#
0
vq
mov
un.s16
d27
,
q15
vdup.16
q0
,
d7
[
2
]
vdup.16
q0
,
d7
[
2
]
vdup.16
q2
,
d7
[
3
]
vdup.16
q2
,
d7
[
3
]
vst1.64
{
d24
-
d27
}
,
[
r0
],
r1
vst1.64
{
d24
-
d27
}
,
[
r0
],
r1
...
@@ -608,20 +608,20 @@ loop_32x32_neon
...
@@ -608,20 +608,20 @@ loop_32x32_neon
vadd.s16
q13
,
q0
,
q9
vadd.s16
q13
,
q0
,
q9
vadd.s16
q14
,
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,
q10
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,
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vadd.s16
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,
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,
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,
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vq
shr
un.s16
d0
,
q12
,
#
0
vq
mov
un.s16
d0
,
q12
vq
shr
un.s16
d1
,
q13
,
#
0
vq
mov
un.s16
d1
,
q13
vadd.s16
q12
,
q2
,
q8
vadd.s16
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,
q2
,
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vadd.s16
q13
,
q2
,
q9
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,
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q9
vq
shr
un.s16
d2
,
q14
,
#
0
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mov
un.s16
d2
,
q14
vq
shr
un.s16
d3
,
q15
,
#
0
vq
mov
un.s16
d3
,
q15
vadd.s16
q14
,
q2
,
q10
vadd.s16
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,
q2
,
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vadd.s16
q15
,
q2
,
q11
vadd.s16
q15
,
q2
,
q11
vst1.64
{
d0
-
d3
}
,
[
r0
],
r1
vst1.64
{
d0
-
d3
}
,
[
r0
],
r1
vq
shr
un.s16
d24
,
q12
,
#
0
vq
mov
un.s16
d24
,
q12
vq
shr
un.s16
d25
,
q13
,
#
0
vq
mov
un.s16
d25
,
q13
vld1.8
{
d0
}
,
[
r3
]
!
; preload 8 left pixels
vld1.8
{
d0
}
,
[
r3
]
!
; preload 8 left pixels
vq
shr
un.s16
d26
,
q14
,
#
0
vq
mov
un.s16
d26
,
q14
vq
shr
un.s16
d27
,
q15
,
#
0
vq
mov
un.s16
d27
,
q15
vmovl.u8
q3
,
d0
vmovl.u8
q3
,
d0
vst1.64
{
d24
-
d27
}
,
[
r0
],
r1
vst1.64
{
d24
-
d27
}
,
[
r0
],
r1
...
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